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description[de] = <b>Werkstatt Design Rules --- <font size=4 color="red">BITTE LESEN!!!</font></b>\n<p>\n<p>\nDiese Design-Rules sind explizit für die Möglichkeiten der EMSP-Werkstatt eingestellt. <br>\nAlles was hier bemängelt wird, sollte nochmal überprüft und angepasst werden.\n<p><br>\n<p>\n<font color="red"><b>ACHTUNG - VOR der Abgabe beachten:</b><p></font color="red">\n<ul>\n0. Vor dem DRC immer den ERC prüfen!\n<br>\n1. Zur DRC-Prüfung & Abgabe nur die zu ätzenden Layer einblenden (Top, Bottom, Pad, Vias, Dimension, Centerdrill).\n<br>\n2. Bitte keine Beschriftungen oder ähnliches in das Layer Dimension legen. Ausschließlich die Schnittkanten der Platinen.\n<br>\n3. Isolate der Polygone wird nicht vom DRC überprüft: Bitte mindestens 0,4mm - besser 0,8mm.\n<br>\n4. Für die Bohrlöcher das ULP Drillaid (0,4mm) ausführen - das erleichtert das Bohren.\n<br>\n5. Beschriftungen setzen: Top, Bottom, 'Ersteller', 'Betreuer', Projekt, etc.\n<br>\n6. Bitte ausschließlich die zu ätzenden Layer einblenden.\n<br>\n7. Benenne die schematic- (.sch) und Board-Datei (.brd) mit Namen/Modul und Anforderungen um ( Einseitig = ES oder Doppelseitig = DS ).\n</ul>\n<p>\n<br>\n<p>\nletzte Aktualisierung: 27.05.2015 von Felix Bohn\n<p>\nErläuterungen (dazu Fenster vergrößern):\n...\n<ul>- Winkel werden auf 45° geprüft, da bei anderen Winkeln kleine Ecken entstehen - diese werden auch vom Drucker entsprechend gedruckt und hindern das Ätzbad am Fließen, so dass besonders bei feinen Bahnen ein schlechteres Ergebnis erzielt wird.<br>\n- Beschriftungen sind für die Zuordnung und für den Prozess der Platinenherstellung unverzichtbar.<br>\n- Drillaid sorgt dafür, dass die Bohrlöcher so aufgefüllt werden, dass nur noch ein kleiner Zentrierungspunkt übrig bleibt. So findet der Bohrer besser das Zentrum des Lochs. Dies ist besonders Wichtig bei Bauelementen mit mehreren Beinchen (ICs, Stecker, etc.).<br>\n- Isolate ist der Abstand des Polygons zu den Leiterbahnen und Pads. Ist dieser zu gering, entstehen beim Löten sehr schnell Kurzschlüsse, da es keine Lötstopmaske gibt.<br>\n</ul>
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description[en] = <b>EAGLE Design Rules</b>\n<p>\nThe default Design Rules have been set to cover\na wide range of applications. Your particular design\nmay have different requirements, so please make the\nnecessary adjustments and save your customized\ndesign rules under a new name.
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layerSetup = (1*16)
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mtCopper = 0.035mm 0.035mm 0.035mm 0.035mm 0.035mm 0.035mm 0.035mm 0.035mm 0.035mm 0.035mm 0.035mm 0.035mm 0.035mm 0.035mm 0.035mm 0.035mm
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mtIsolate = 1.5mm 0.15mm 0.2mm 0.15mm 0.2mm 0.15mm 0.2mm 0.15mm 0.2mm 0.15mm 0.2mm 0.15mm 0.2mm 0.15mm 0.2mm
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mdWireWire = 8mil
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mdWirePad = 8mil
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mdWireVia = 8mil
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mdPadPad = 8mil
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mdPadVia = 8mil
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mdViaVia = 8mil
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mdSmdPad = 8mil
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mdSmdVia = 8mil
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mdSmdSmd = 8mil
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mdViaViaSameLayer = 8mil
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mnLayersViaInSmd = 2
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mdCopperDimension = 20mil
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mdDrill = 8mil
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mdSmdStop = 0mil
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msWidth = 10mil
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msDrill = 20mil
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msMicroVia = 20mil
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msBlindViaRatio = 0.500000
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rvPadTop = 0.400000
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rvPadInner = 0.400000
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rvPadBottom = 0.400000
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rvViaOuter = 0.400000
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rvViaInner = 0.400000
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rvMicroViaOuter = 0.250000
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rvMicroViaInner = 0.250000
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rlMinPadTop = 10mil
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rlMaxPadTop = 40mil
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rlMinPadInner = 10mil
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rlMaxPadInner = 40mil
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rlMinPadBottom = 10mil
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rlMaxPadBottom = 40mil
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rlMinViaOuter = 8mil
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rlMaxViaOuter = 40mil
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rlMinViaInner = 8mil
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rlMaxViaInner = 40mil
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rlMinMicroViaOuter = 4mil
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rlMaxMicroViaOuter = 20mil
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rlMinMicroViaInner = 4mil
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rlMaxMicroViaInner = 20mil
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psTop = -1
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psBottom = -1
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psFirst = -1
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psElongationLong = 100
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psElongationOffset = 100
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mvStopFrame = 1.000000
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mvCreamFrame = 0.000000
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mlMinStopFrame = 4mil
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mlMaxStopFrame = 4mil
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mlMinCreamFrame = 0mil
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mlMaxCreamFrame = 0mil
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mlViaStopLimit = 0mil
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srRoundness = 0.000000
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srMinRoundness = 0mil
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srMaxRoundness = 0mil
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slThermalIsolate = 15mil
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slThermalsForVias = 1
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dpMaxLengthDifference = 10mm
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dpGapFactor = 2.500000
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checkGrid = 0
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checkAngle = 1
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checkFont = 1
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checkRestrict = 1
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useDiameter = 31
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maxErrors = 50
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